sram chips
SRAM晶片
sram memory
SRAM記憶體
sram cache
SRAM快取記憶體
sram module
SRAM模組
sram cell
SRAM儲存單元
sram array
SRAM陣列
sram buffer
SRAM緩衝器
sram blocks
SRAM區塊
embedded sram
嵌入式SRAM
low-power sram
低功耗SRAM
the mcu boots faster when you store the lookup table in sram.
當你將查找表存儲在SRAM中時，MCU的啟動速度會更快。
this soc includes 512 kb of sram for real time tasks.
此SOC包含512 KB的SRAM用於實時任務。
the dsp keeps its working set in sram to reduce latency.
DSP將其工作集保留在SRAM中以減少延遲。
place the interrupt stack in sram for predictable access time.
將中斷堆棧放在SRAM中以獲得可預測的訪問時間。
enable sram retention during sleep to preserve state.
在睡眠期間啟用SRAM保留以保持狀態。
sram reads are fast, but the capacity is limited.
SRAM的讀取速度很快，但容量有限。
the compiler spills hot variables into sram for speed.
編譯器將熱變量溢出到SRAM中以提高速度。
we mapped the frame buffer into sram to avoid tearing.
我們將幀緩衝區映射到SRAM中以避免撕裂。
sram power consumption rises when the clock frequency increases.
當時鐘頻率增加時，SRAM的功耗會增加。
the cache uses sram cells to achieve low access latency.
緩存使用SRAM單元以實現低訪問延遲。
run a march test to validate sram integrity on startup.
在啟動時運行March測試以驗證SRAM的完整性。
sram bit errors can appear under voltage droop conditions.
在電壓下降條件下可能會出現SRAM位錯誤。
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SRAM晶片
sram memory
SRAM記憶體
sram cache
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SRAM模組
sram cell
SRAM儲存單元
sram array
SRAM陣列
sram buffer
SRAM緩衝器
sram blocks
SRAM區塊
embedded sram
嵌入式SRAM
low-power sram
低功耗SRAM
the mcu boots faster when you store the lookup table in sram.
當你將查找表存儲在SRAM中時，MCU的啟動速度會更快。
this soc includes 512 kb of sram for real time tasks.
此SOC包含512 KB的SRAM用於實時任務。
the dsp keeps its working set in sram to reduce latency.
DSP將其工作集保留在SRAM中以減少延遲。
place the interrupt stack in sram for predictable access time.
將中斷堆棧放在SRAM中以獲得可預測的訪問時間。
enable sram retention during sleep to preserve state.
在睡眠期間啟用SRAM保留以保持狀態。
sram reads are fast, but the capacity is limited.
SRAM的讀取速度很快，但容量有限。
the compiler spills hot variables into sram for speed.
編譯器將熱變量溢出到SRAM中以提高速度。
we mapped the frame buffer into sram to avoid tearing.
我們將幀緩衝區映射到SRAM中以避免撕裂。
sram power consumption rises when the clock frequency increases.
當時鐘頻率增加時，SRAM的功耗會增加。
the cache uses sram cells to achieve low access latency.
緩存使用SRAM單元以實現低訪問延遲。
run a march test to validate sram integrity on startup.
在啟動時運行March測試以驗證SRAM的完整性。
sram bit errors can appear under voltage droop conditions.
在電壓下降條件下可能會出現SRAM位錯誤。
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